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ENCYCLOPÉDIE DE LA RADIOÉLECTRONIQUE ET DU GÉNIE ÉLECTRIQUE Microcontrôleurs 8XC51CB d'INTEL. Encyclopédie de l'électronique radio et de l'électrotechnique
Encyclopédie de l'électronique radio et de l'électrotechnique / microcontrôleurs Le groupe 8XC51GB comprend les microcontrôleurs 80C51GB, 83C51GB, 87C51GB, 80C51GB-1, 83C51GB-1 et 87C51GB-1. Au moment de la rédaction, tous étaient produits dans un boîtier PLCC à 68 broches et étaient marqués du préfixe N (N80C51GB, N83C51GB, etc.). Les puces sont fabriquées selon la technologie SNMOS III-E d'Intel. Les versions avec une ROM interne programmable n'ont pas de fenêtre transparente dans le boîtier, c'est-à-dire qu'elles appartiennent à la catégorie des ROM programmables une seule fois. Cela limite quelque peu le cercle de leurs consommateurs du fait que lors du débogage, il n'est pas possible de travailler par essais et erreurs avec une reprogrammation répétée du cristal, mais il est nécessaire d'utiliser l'émulateur approprié. Les trois premiers contrôleurs ci-dessus fonctionnent à une fréquence de signal d'horloge de 3,5 à 12 MHz, les autres fonctionnent dans la plage de fréquences de 3,5 à 16 MHz. La tension d'alimentation de tous les contrôleurs est de 5 V, les versions basse tension n'ont pas été produites. Principales caractéristiques techniques des contrôleurs du groupe 8хС51GB :
La plupart de ces caractéristiques sont inhérentes à toute la famille MSS51, nous ne nous y attarderons donc pas en détail. Pour ceux qui ne les connaissent pas, nous vous recommandons de vous référer aux articles sur les micro-ordinateurs monopuces publiés dans [1-3]. De plus, lors de l'analyse des microcontrôleurs 8xC51Fx, 8x151Fx [4], un tableau de compteurs programmables a été décrit en détail, et donc il ne sera également considéré que du point de vue de ses différences par rapport à celui disponible dans 8xX51Fx. Le sujet de notre connaissance sera celui des caractéristiques du 8xC51GB qu'aucun des autres groupes de la famille MCS51 n'a. Notez que les contrôleurs 80C51GB et 80C51GB-1 ne contiennent pas de mémoire programme interne, 83C51GB et 83C51GB-1 ont une ROM programmable par masque d'une capacité de 8 et 16 Ko, respectivement, et 87C51GB et 87C51GB-1 ont une ROM reprogrammable avec un capacité de 8 et 32 Ko, respectivement. OBJET DES CONCLUSIONS L'objet des conclusions des contrôleurs du groupe concerné est le suivant :
La plupart de ces conclusions sont familières à ceux qui ont déjà traité des microcontrôleurs de la famille MSS51. Nouveau sont les broches des ports P4, P5 avec leurs fonctions alternatives (elles sont données après le signe /), les broches d'alimentation (AVrol, AVss) et les signaux associés à l'ADC (COMPREF, ACH0-ACH7, TRIGIN), qui seront pris en compte lors de la description des appareils correspondants. Le port RO est similaire aux ports correspondants des microcircuits antérieurs et remplit les mêmes fonctions. Les contrôleurs 8xC51GB ont deux nouveaux ports - P4 et P5. Comme R1-RZ. ce sont des ports d'E/S quasi-bidirectionnels à huit bits avec une résistance interne élevée pour garantir que les sorties passent rapidement à la logique 1 lorsqu'elles sont commutées. La résistance est connectée à l'étage de sortie pendant deux cycles d'horloge pour amener la sortie à l'état spécifié, puis déconnectée. Les sorties des ports P1-P5, qui sont à l'état logique 1, ont un potentiel élevé en raison de la résistance interne et peuvent être utilisées comme entrées dans cet état. Contrairement à RO, les lignes d'entrée des ports P1-P5 sont équipées de déclencheurs de Schmitt. Presque toutes les broches de port ont un objectif alternatif (tableau 1). Lors de la réinitialisation, les sorties du port RH sont définies sur un seul état, les autres sont définies sur zéro. Entrez RESET# - réinitialiser. Un niveau bas sur cette entrée pendant deux cycles machine alors que le générateur d'horloge fonctionne provoque la réinitialisation du contrôleur. Les broches du port sont mises à leur état initial au moment où la tension à l'entrée RESET# tombe à 0,3 ... 0,4 V. La procédure de réinitialisation dure cinq cycles machine (60 cycles d'horloge). Il faut faire attention au fait que la polarité des signaux de réinitialisation des microcontrôleurs du groupe 8xC81GB est opposée par rapport aux autres microcircuits de la famille MSS51. Les raisons de cette inversion sont inconnues de l'auteur. L'entrée ALE/PROG# est complètement similaire à l'entrée correspondante des autres contrôleurs de la famille MSS51. Notez qu'en 8xC51GB, l'utilisateur a la possibilité de désactiver la sortie du signal ALE. en mettant à 0 le bit de poids faible du registre SFR, situé à l'adresse 8EH. Le signal A1E n'est émis qu'au moment de l'action de la commande MO\/C ou MO\/X, dans les autres cas, un seul niveau est maintenu sur cette broche. Lorsque vous travaillez uniquement avec le programme interne et la mémoire de données, il n'y aura aucun signal à la sortie ALE. L'entrée EA#/Vpp est utilisée pour activer la récupération des commandes de la mémoire de programme interne, s'il y en a une sur la puce et que l'entrée est connectée à un fil commun. Lorsqu'un seul niveau lui est appliqué, le programme de la mémoire programme externe est exécuté. Cependant, ce dernier n'est possible que jusqu'à ce que les bits de protection de la mémoire de programme interne soient définis, ce qui sera décrit ci-dessous. La tension de programmation Vpp = 12,75 V est appliquée à cette broche lors de la programmation de la ROM interne des microcircuits 87C51GB, 87C51GB-1. DIFFÉRENCES 8ХС51GВ DES AUTRES PRODUITS DE LA FAMILLE MCS51 Alors, énumérons les différences les plus significatives entre les contrôleurs 8xC51GB. Ce sont:
CAN NŒUD L'ADC des microcontrôleurs 8хС51GB (voir le schéma fonctionnel de la Fig. 1) possède huit entrées analogiques (sorties ASN0-ACN7), une entrée de déclenchement externe TRIGIN, des sorties de puissance (AVHrol) et un fil commun (AVss) de la partie analogique, isolés galvaniquement des sorties numériques correspondantes, ainsi que la sortie de la tension de comparaison de référence (exemple) COMPREF. L'ADC comprend un multiplexeur à huit canaux, un réseau résistif à 256 éléments, un comparateur, un dispositif d'échantillonnage/blocage, huit registres de résultats, un registre d'approximations successives et un registre de résultats de comparaison. En fait, il y a 10 registres supplémentaires dans l'espace SFR. Les registres AD0-AD7 (84Н, 94Н, 0А4Н, 0В4Н, 0С4Н, 0D4Н, 0Е4Н, 0F4Н) contiennent les résultats de conversion pour chacun des huit canaux. La valeur de chaque registre est mise à jour à la fin de la conversion dans le canal correspondant, en commençant par le canal 0. Le registre des résultats de comparaison ACMP (0С7Н) contient huit drapeaux qui reflètent les résultats de la comparaison des signaux aux entrées analogiques ASN0-ACN7 avec la tension à l'entrée COMPREF (tableau 3). Le drapeau correspondant est mis à 1 si la tension d'entrée à cette entrée analogique dépasse COMPREF", sinon le drapeau est effacé. Le registre ACOM (097H) contient l'indicateur d'interruption ADC ALF, le bit d'activation de conversion ACE, deux bits de sélection de canal ACSO et ACS1, le mode d'entrée AIM et les bits de mode de démarrage ATM (tableau 4).
MODE COMPARER Ce mode est toujours actif et est utilisé pour comparer les tensions aux entrées ACH0-ACN7 avec la tension de référence fournie à l'entrée COMPREF du contrôleur. Chaque fois que l'ADC est démarré, l'état de chaque bit du registre ASMR change pour un nouveau, à partir de canal 0, quel que soit le mode d'interrogation de canal défini. Le mode vous permet de comparer rapidement le type de plus ou moins deux signaux analogiques à l'aide d'une méthode matérielle, ce qui peut réduire et simplifier considérablement le programme en cours d'exécution. Si le mode de comparaison n'est pas utilisé, n'importe quelle tension de Vcc à Vss peut être appliquée à l'entrée COMPREF. MODE DE DÉMARRAGE L'ADC peut être déclenché à partir de sources internes et externes. Dans le premier cas, le bit ATM du registre ACON doit être mis à 1. Dans ce mode, dans le cycle suivant celui où le bit ACE a été mis à 1, la conversion démarre à partir du canal 0. Une fois la conversion terminée , le drapeau ALF est défini sur le canal 1. ADC activé, le réglage du drapeau à 0 provoque une interruption sur le vecteur ADC. Un nouveau cycle commence après la fin du précédent. La mise à XNUMX du bit ACE termine la conversion, En mode de déclenchement externe, la conversion démarre lorsqu'il y a un niveau zéro à l'entrée TRIGIN. Cette entrée n'est pas à verrouillage frontal et son état est déterminé en interrogeant chaque cycle machine. Autrement dit, pour démarrer la conversion, la durée du signal de niveau zéro à l'entrée TRIGIN doit être supérieure à la durée du cycle machine. Après le démarrage de la boucle jusqu'à ce qu'elle se termine, l'état de l'entrée TRIGIN est ignoré et la conversion s'effectue de la même manière que dans le cas précédent. Une fois le cycle terminé, le CAN s'arrête jusqu'à ce qu'une nouvelle impulsion arrive à l'entrée TRIGIN ou jusqu'à ce qu'il soit déclenché en interne par le bit ACE.
CONNEXION Le réglage du bit AIM sur 0 place l'ADC dans le mode dit de balayage, dans lequel la conversion est effectuée dans la séquence ACH1, ACH7 ..... ACH1. Les résultats de la conversion sont placés respectivement dans les registres ADO. AD7.....ADXNUMX. Lorsque le bit AIM est mis à 1 après le démarrage de l'ADC, quatre conversions de signal consécutives sont effectuées dans le canal, dont le nombre est déterminé par l'état des bits ACS0 et ACS1 du registre ACON. Les résultats de ces mesures de signal sur la voie sélectionnée sont écrits dans les registres AD0-AD3. Après cet ADC. comme en mode balayage, interroge les canaux ACH4-ACN7. les résultats de la conversion sont enregistrés dans AD4-AD7. UTILISATION DE L'ADC POUR MOINS DE CANAUX
Il existe plusieurs options pour utiliser des ADC avec moins de huit canaux. Si le temps de conversion n'est pas critique, vous pouvez simplement attendre l'interruption après la fin de la conversion dans le septième canal et lire les résultats uniquement à partir des canaux sélectionnés. S'il est important d'obtenir le résultat immédiatement après la fin de la conversion dans le canal sélectionné, Intel suggère de compter l'intervalle de temps souhaité à l'aide d'une minuterie et de ses interruptions. Une autre méthode recommandée consiste à interroger périodiquement l'état du registre de résultats correspondant. Son évolution informe qu'une nouvelle conversion a eu lieu (cependant, cette méthode ne convient que si la tension mesurée n'est pas constante). L'utilisation du mode de sélection de voie ne réduit pas le temps de conversion, mais augmente seulement le nombre de mesures dans la voie sélectionnée par cycle. ADC EN MODE MICROPUISSANCE L'ADC des contrôleurs 8xC51GB comprend un circuit qui limite la consommation électrique du nœud en modes XX et MP à la valeur du courant de fuite. Pour le fonctionnement normal de ce circuit, le potentiel d'utilisation doit être appliqué sur la broche AVioi du microcontrôleur. Pendant que l'ADC est en mode basse consommation, la tension d'alimentation peut être réduite à 2,5 V. TABLEAUX DE COMPTEURS PROGRAMMABLES Le microcontrôleur 8xC51GB comprend un réseau de compteurs programmables (PCA), similaire à celui utilisé dans 8xC51Fx [4]. Cependant, 8xC51GB possède également une deuxième baie similaire - PCA1. Ses différences avec RSA sont les suivantes :
Les microcontrôleurs 8хС51GB prennent en charge 15 vecteurs d'interruption (tab. 6). Les cinq inférieurs d'entre eux sont similaires à ceux disponibles dans tous les contrôleurs de la famille MSS51, le sixième sert le troisième minuteur / compteur (il n'est apparu qu'à partir des cristaux de la famille MSS52), le septième, disponible uniquement en 8xC51FX, 8x151FX et 8xC51GB, prend en charge une matrice de compteur programmable (PCA). Ce dernier dispose en outre d'interruptions provenant de cinq entrées externes (INT2 - INT6). deuxième matrice de compteurs programmables, ADC et port série étendu.
Dans tous les contrôleurs de la famille MSS51, chaque interruption peut être désactivée en mettant le bit correspondant dans le registre IE à un niveau bas, ce qui est bien sûr également vrai pour 8xC51GB. Cependant, comme il contient deux fois plus de sources d'interruption, un registre IEA supplémentaire est utilisé pour les activer/désactiver (tableau 7). Comme dans le cas précédent, la mise à 1 du bit active l'interruption correspondante, la remise à 0 la désactive. Adresse de registre IEA-0A7H. Notez que toutes les interruptions, y compris celles décrites dans le tableau. 7 peut être désactivé simultanément en mettant le bit EA (IE.0), le bit le plus significatif du registre IE, à 7.
Chaque interruption peut avoir sa propre priorité (du niveau 0 - le plus bas, au niveau 3 - le plus élevé). Le niveau de priorité est déterminé par l'état des bits dans les paires de registres IP, IPH et IPA, IPHA. Le premier d'entre eux est identique à ceux trouvés dans les contrôleurs précédents et est décrit en détail lors de l'examen du groupe 8xC51Fx. La deuxième paire (adresses de registre 0V8H et 0V6H, respectivement) n'est disponible que dans 8xC51GB et dessert les interruptions qui se trouvent uniquement dans ces contrôleurs. En tableau. 8 montre la correspondance entre les bits des registres et les interruptions dont ils déterminent le niveau, en tableau. 9 - correspondance entre les niveaux de priorité et l'état des bits dans les paires de registres IP, IPH et IPA, IPHA.
Les interruptions de faible priorité ne peuvent à leur tour être interrompues que par un événement de priorité supérieure (mais non égale). Par conséquent, une interruption avec la priorité la plus élevée ne peut pas être interrompue. Si le processeur reçoit simultanément des demandes pour deux interruptions ou plus avec la même priorité, alors l'ordre dans lequel elles sont traitées est déterminé par une séquence spéciale d'interrogation du drapeau d'interruption. Pour les contrôleurs 8xС51GB, cela ressemble à ceci :
Les interruptions externes I NT0 et INT1 du microcontrôleur 8xC51GB correspondent entièrement aux interruptions similaires de tous les microcircuits de la famille MSS51 et, en fonction de l'état des bits ITO et IT1 du registre TCON, peuvent être fixées à la fois en niveau et en différence de 1 à 0. Les broches externes INT2 et INTZ peuvent répondre à la fois au front positif et négatif du signal. Le microcircuit a un registre EXICON (0С6Н) contenant les bits IT2 et ITZ, qui déterminent le front actif du signal aux broches P5.2 (INT2) et P5.3 (INTТЗ). Lorsque le bit ITn est à 0, l'interruption est initiée sur front descendant, lorsque ITn = 1, sur front montant. Les événements externes INT4 - INT6 sont fixés uniquement sur front montant aux sorties P5.4(INT4) - P5.6(INT6). Toutes les interruptions externes génèrent des drapeaux correspondants configurables par le matériel. Pour les événements INTO, INT1 sont les bits 1E0 et IE1 du registre TCON. Les drapeaux IE2-IE6 sont dans le registre EXICON. Ils sont réinitialisés par le matériel au moment où le processeur passe au sous-programme de traitement d'interruption correspondant. Pendant le cycle de la machine, les broches d'interruption externes ne sont interrogées qu'une seule fois. Ainsi, pour qu'une interruption soit enregistrée, la durée de son niveau actif doit dépasser la durée d'un cycle machine (12 cycles d'horloge). Le but des bits du registre EXICON est indiqué dans le tableau. dix.
PORT SÉRIE AVANCÉ Le port série amélioré (SEP) dispose du matériel pour mettre en œuvre le bus 1C, la norme de facto pour les communications série. SEP permet un fonctionnement dans quatre modes différents, dispose de trois sources d'horloge différentes. Pour ses besoins, deux sorties du microcircuit sont impliquées: P4.1 - entrée / sortie de données et P4.0 - pour émettre le signal d'horloge. Un paquet transmis ou reçu se compose de huit bits de données. Dans ce cas, huit cycles de fonctionnement SEP sont utilisés. En l'absence d'informations reçues ou transmises, le signal d'horloge et les données sont inactifs. Trois registres SFR sont affectés à SEP : SEPCON (0D7H), SEPDAT (0E7H) et SEPSTAT (0F7H). Ils ne sont adressés qu'octet par octet. L'affectation des bits dans les registres SEPCON et SEPSTAT est donnée dans le tableau. 11 et 12 respectivement.
Sur la fig. La figure 2 montre les caractéristiques distinctives des modes de fonctionnement SEP - les niveaux actifs du signal d'horloge et les fronts utilisés pour la réception ou la transmission. Comme il ressort du tableau. 11, le mode de fonctionnement SEP est déterminé par l'état des bits CLKPOL et CLKPH situés dans le registre SEPCON.
Pour recevoir ou transmettre un octet, l'utilisateur doit sélectionner le mode de fonctionnement du port (bits CLKPOL et CLKPH), le débit en bauds (SEPS1 et SEPS0) et régler le bit SEPE sur 1. Le processus de transfert commence immédiatement après le chargement de l'octet dans le Registre SEPDATA. Une réception est lancée en mettant le bit SEPREN à 1 lorsque le registre SEPDATA est vide et qu'il n'y a pas de transmission. Après avoir reçu huit bits, SEPREN est réinitialisé par le matériel. L'achèvement d'une réception ou d'une transmission entraîne la mise à 1 du bit SEPIF. Sa réinitialisation n'est possible que par logiciel. Si l'utilisateur tente d'écrire (ou de lire) dans le registre SEPDATA pendant la transmission ou la réception, le bit d'erreur correspondant est défini. L'indicateur SEPFWR est défini lors d'une tentative de transmission d'octets, et SEPFRD est défini lors d'une réception. Il n'y a pas d'interruptions associées à la définition de ces bits, l'utilisateur doit donc contrôler leur état indépendamment. Naturellement, la réinitialisation de ces drapeaux ne peut être effectuée que par programme. MINUTERIE MATÉRIELLE Le temporisateur de chien de garde matériel (HWDT) réinitialise le microcontrôleur lorsqu'il déborde, ce qui est un moyen de lutter contre un blocage du système (boucle de programme). Le temporisateur/compteur du module PCA 4 peut également être configuré pour exécuter une fonction similaire, mais une telle utilisation de celui-ci limite les capacités de l'utilisateur, et donc un WDT indépendant est apparu dans 8xC51GB qui ne nécessite pas l'utilisation de PCA. Le chien de garde matériel se compose d'un compteur 14 bits qui est incrémenté à chaque cycle machine et du registre SFR WDTRST (0A6H). La minuterie est toujours active et incrémente continuellement le compteur pendant que l'horloge tourne. Il n'y a aucun moyen d'arrêter la minuterie. Si le programme utilisateur n'écrit aucune information dans WDTRST, alors tous les 16 384 cycles machine, le HWDT génère un signal RESET, qui réinitialise le microcontrôleur. Cela réinitialise le compteur. Pour empêcher le fonctionnement du HWDT, le programme utilisateur avec un intervalle d'au moins 16 383 cyclones machine doit entrer séquentiellement deux octets dans le registre WDTRST - 01EH et 0A6H. Notez que dans WDTRST vous ne pouvez écrire que des informations, il n'y a aucun moyen de lire son contenu. Il n'est pas recommandé d'effectuer ledit redémarrage du temporisateur chien de garde à l'aide d'une routine de service d'interruption de l'un des temporisateurs/compteurs, car les interruptions peuvent être traitées même lorsque le programme principal est bloqué. Le meilleur endroit pour placer les commandes de réinitialisation du chien de garde est dans un morceau de code en boucle qui a une période de répétition inférieure au temps de déclenchement du HWDT.
Mettre le 8xC51GB en mode micro-alimentation arrête l'horloge interne et HWDT. La suppression du contrôleur du mode micro-alimentation, comme tous ses prédécesseurs, peut se faire de deux manières: en réinitialisant ou en appelant une interruption externe, activée avant que le 8xC51GB ne passe au mode nommé. Dans le premier cas, le HWDT est réinitialisé, dans le second, au démarrage du générateur d'horloge, le contenu du compteur HWDT va continuer à augmenter. Mais comme pour un démarrage stable du générateur d'horloge, un temps d'environ deux douzaines de ses périodes est requis, il est recommandé que la durée de l'impulsion d'interruption externe, qui fait sortir le contrôleur du mode de micro-consommation, ne soit pas inférieure que le temps mentionné. Le gestionnaire d'interruption ne commencera à s'exécuter qu'après que le niveau du signal d'interruption externe passe à 1, lorsque la fréquence de génération se stabilise. En même temps, l'incrémentation du compteur HWDT commencera, c'est-à-dire que tant que le signal d'interruption a un niveau zéro, le HWDT ne fonctionne pas. En mode XX, le générateur d'horloge du contrôleur n'est pas désactivé. Par conséquent, le contenu du compteur HWDT augmente continuellement et pour empêcher une réinitialisation, il est nécessaire d'utiliser une interruption de minuterie, qui quittera ce mode, réinitialisera le compteur de minuterie de chien de garde et reviendra en mode inactif. L'extrait de code suivant utilise l'interruption T/CO pour réinitialiser périodiquement le HWDT. Certes, comme indiqué ci-dessus, l'utilisation d'une telle interruption n'est pas le meilleur endroit pour réinitialiser le compteur, et il est préférable d'intégrer une telle procédure dans une partie exécutée périodiquement du programme - interrogation du clavier ou affichage d'informations. Par conséquent, le fragment ci-dessus doit être considéré comme un exemple de démonstration et non comme un sous-programme qui doit être utilisé dans des programmes sans aucun changement. DÉTECTION DE PANNE D'HORLOGE Le circuit de détection de panne d'oscillateur (OFD) est conçu pour réinitialiser le microcontrôleur si la fréquence de l'oscillateur tombe en dessous d'une limite de spécification. Si après la réinitialisation, la fréquence d'horloge ne change pas (ou plutôt, n'augmente pas jusqu'à une valeur acceptable), le contrôleur restera dans cet état. Notez que le dépassement de la fréquence au-dessus de la limite définie n'entraîne pas sa réinitialisation. Le circuit OFD s'allume toujours après une réinitialisation ou lorsque le contrôleur quitte le mode de micro-demande. Pour le désactiver, écrivez 0E1H et 01EH en séquence dans le registre OSCR (0A5H). Cela doit être fait, en particulier, avant de passer en mode micro-consommation, puisque le générateur d'horloge y est éteint. Le circuit ne peut être autorisé à fonctionner à nouveau qu'en réinitialisant ou en sortant du mode de micro-consommation par une interruption externe. L'état du circuit OFD peut être déterminé en lisant le registre OSCR. Si OSCR=0FFH, la détection de défaut est activée, si OSCR=0FEH, elle est désactivée, CONCLUSION Nous avons donc fini de passer en revue les fonctionnalités des microcontrôleurs huit bits de la famille MCS51, développés et fabriqués par Intel. Ils se sont avérés être un tel succès que la réplication de beaucoup d'entre eux (avec quelques améliorations technologiques) se poursuit à ce jour. La demande constante pour ces contrôleurs est déterminée par le fait que des centaines de milliers de développeurs s'y sont habitués, ont développé une quantité énorme de logiciels et ont acquis une flotte d'outils de débogage et d'outils croisés. Dans de nombreux cas, un nouveau développement ne nécessite pas de remplacer le microcontrôleur par quelque chose de radicalement nouveau, et il est donc plus opportun de le réaliser sur ce qui est déjà familier et doté d'outils de support, plutôt que de dépenser des efforts et de l'argent pour passer à un autre base de l'élément. Pour cette raison, Intel a régulièrement amélioré ses contrôleurs pour élargir la gamme de tâches résolues avec leur utilisation. De plus, les entreprises qui n'avaient aucun lien avec le développement initial se sont jointes à cette amélioration. Ainsi, aujourd'hui, les microcontrôleurs compatibles avec cette famille sont produits par Philips, Siemens, Dallas Semiconductor, Atmel, OKI et certains fabricants moins connus, y compris un certain nombre d'entreprises de l'ex-URSS. Tous les contrôleurs ont le même ensemble de commandes et l'architecture de base, en règle générale, sont compatibles en "brochage" et ont des algorithmes de programmation similaires. Cependant, il existe des différences significatives dans l'ensemble de registres et de matériel supplémentaires. Ainsi, les microcontrôleurs Dallas Semiconductor ont deux registres DPTR et un mécanisme pour les commuter, les produits Philips ont un ADC à capacité accrue, les contrôleurs Siemens ont souvent une mémoire externe sur la puce, adressée par des commandes MOVX, etc. littérature
Auteur : A. Frunze, Moscou
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