Bibliothèque technique gratuite ENCYCLOPÉDIE DE LA RADIOÉLECTRONIQUE ET DU GÉNIE ÉLECTRIQUE Puces de mémoire SAMSUNG FLASH. Donnée de référence Encyclopédie de l'électronique radio et de l'électrotechnique / Application de microcircuits L'article décrit les puces de mémoire flash 4 Gbit K9K4G08Q0M-YCB0/YIB0, K9K4G16Q0M- YCBO/YIBO, K9K4G08U0M- YCBO/YIBO, K9K4G16U0M-YCB0/YIB0. Ces microcircuits sont utilisés comme mémoire non volatile dans les appareils grand public, industriels et informatiques. Dans les caméras vidéo et photo numériques, les enregistreurs vocaux et les répondeurs, ces puces sont utilisées comme mémoire pour l'image et le son dans le cadre des lecteurs flash à semi-conducteurs. Les puces de mémoire flash sont divisées en groupes selon la tension d'alimentation et l'architecture (tableau 1). En tableau. 2 montre l'affectation des broches des puces de mémoire flash. Tableau 1
Tableau 2
Les puces K9K4GXXX0M ont une capacité de 4 Go avec 128 Mo de réserve (la capacité réelle est de 4 429 185 024 bits) et une architecture de 512 Mo x 8 ou 256 Mo x 16 avec une fiabilité allant jusqu'à 1 M de cycles d'écriture/effacement. Les puces 8 bits sont organisées en 2112 x 8 pages, tandis que les puces 16 bits sont organisées en 1056 x 16 colonnes. Tous les microcircuits ont des bits de réserve situés dans 128 rangées avec les adresses 2048-2111 pour les microcircuits 8 bits, ou dans 64 colonnes avec les adresses 1024-1055 pour les microcircuits 16 bits. Pour organiser le transfert de données lors d'une opération de lecture/écriture de page entre les cellules mémoire et les ports d'E/S, ces microcircuits possèdent des registres de données de taille 2112 octets pour un microcircuit 8 bits, ou 1056 mots pour un microcircuit 16 bits et des registres connectés en série avec l'autre cache de la taille appropriée. La matrice mémoire est construite à partir de 32 cellules connectées situées sur des pages différentes et unies par une structure NAND. 32 cellules qui combinent 135168 structures 2I-NOT et sont situées sur 64 pages forment un bloc. Une collection de blocs de 8 ou 16 bits constitue une matrice mémoire. L'opération de lecture s'effectue page par page, tandis que l'opération d'effacement se fait uniquement bloc par bloc : 2048 blocs effaçables individuellement ps 128 Ko (pour les microcircuits 8 bits), ou blocs de 64 Kmots (pour les microcircuits 16 bits). L'effacement de bits individuels n'est pas possible. L'écriture d'une page sur les microcircuits s'effectue en 300 μs, l'effacement - en 2 ms par bloc (128 Ko pour les microcircuits 8 bits, ou 64 Kmots pour les microcircuits 16 bits). Un octet de données est lu à partir d'une page en 50 ns. Pour enregistrer et contrôler les données dans les micropuces, il existe un contrôleur intégré qui fournit l'ensemble du processus, y compris, si nécessaire, la répétition des opérations de vérification interne et d'étiquetage des données. Les microcircuits K9K4GXXX0M disposent d'un système de vérification des informations avec correction des erreurs et élimination des données erronées en temps réel. Les puces ont 8 ou 16 adresses d'E/S multiplex. Cette solution réduit considérablement le nombre de sorties impliquées et permet des mises à niveau ultérieures des appareils sans augmenter leur taille. Les commandes, les adresses et les données sont entrées à un niveau bas sur la broche CE par la chute du signal WE à travers les mêmes broches d'entrée / sortie. Les informations d'entrée sont écrites dans les registres tampons sur le front montant du signal WE. Les signaux d'activation d'écriture de commande (CLE) et d'activation d'écriture d'adresse (ALE) sont utilisés pour multiplexer la commande et l'adresse, respectivement, via les mêmes broches d'E/S. Tableau 3
* L'entrée/sortie arbitraire de données est possible sur une page En tableau. La figure 3 montre les commandes de contrôle des microcircuits. La soumission aux entrées d'autres codes de commande hexadécimaux (HEX) qui ne sont pas répertoriés dans le tableau entraîne des conséquences imprévisibles et est donc interdite. Pour améliorer la vitesse d'écriture lors de la réception de grandes quantités de données, le contrôleur intégré a la capacité d'écrire des données dans des registres de cache. Lors de la mise sous tension, le contrôleur intégré fournit automatiquement l'accès à la matrice de mémoire, à partir de la première page sans entrer de commande ni d'adresse. En plus de l'architecture et de l'interface améliorées, le contrôleur a la capacité de copier (écraser) le contenu d'une page mémoire sur une autre sans accéder à la mémoire tampon externe. Dans ce cas, la vitesse de transfert des données est plus rapide qu'en fonctionnement normal, car il n'y a pas d'accès séquentiels et de cycles de saisie de données chronophages. Bloquer l'abattage Les blocs de mémoire dans les puces K9K4GXXX0M sont définis comme invalides s'ils contiennent un ou plusieurs bits invalides qui ne peuvent pas être lus sans ambiguïté. Les informations provenant de blocs invalides sont traitées comme des "informations de bloc invalides". Les puces avec des blocs invalides ne diffèrent pas dans les caractéristiques statiques et dynamiques et ont le même niveau de qualité que les puces avec tous les blocs corrects. Les blocs invalides n'affectent pas le fonctionnement des blocs normaux car ils sont isolés du bit et du rail d'alimentation commun par le transistor de sélection. Le système est conçu de telle manière que les adresses sont bloquées pour les blocs invalides. En conséquence, il n'y a tout simplement pas d'accès aux bits incorrects. Identification de bloc invalide Le contenu de toutes les cellules du microcircuit (à l'exception de celles où sont stockées des informations sur les blocs invalides) avec des adresses FFh pour 8 bits et FFFFh pour 16 bits peut être effacé. Les adresses des blocs invalides situés dans la zone de réserve de la matrice mémoire sont déterminées par le premier octet pour les puces 8 bits ou le premier mot pour les puces 16 bits. Le fabricant garantit que la 1ère ou la 2ème page de chaque bloc avec des adresses de cellules invalides contient des données dans des colonnes avec des adresses 2048 (pour 8 bits) ou 1024 (pour 16 bits) différentes de FFh ou FFFFh, respectivement . Étant donné que les informations sur les blocs invalides sont également effaçables, dans la plupart des cas, l'effacement des adresses des blocs défectueux ne peut pas être restauré. Par conséquent, le système doit disposer d'un algorithme capable de créer une table de blocs invalides, protégée contre l'effacement et basée sur les informations initiales sur les blocs défectueux. Après effacement du plan mémoire, les adresses de ces blocs sont à nouveau chargées à partir de cette table. Tout effacement intentionnel des informations d'origine sur les blocs invalides est interdit, car cela entraîne un fonctionnement incorrect du système dans son ensemble. Au fil du temps, le nombre de blocs non valides peut augmenter, vous devez donc vérifier périodiquement la capacité réelle de la mémoire en comparant les adresses des blocs non valides aux données de la table de sauvegarde des blocs non valides. Pour les systèmes nécessitant une tolérance élevée aux pannes, il est préférable de prévoir la possibilité de réécrire bloc par bloc d'une matrice mémoire avec une comparaison des résultats avec les données réelles, identifiant et remplaçant rapidement les blocs d'informations incorrectes. Les données du bloc invalide identifié sont transférées vers un autre bloc vide normal, sans affecter les blocs voisins du tableau et en utilisant le tampon intégré, dont la taille correspond à la taille du bloc. Pour cela, des commandes de réécriture bloc par bloc sont fournies. Publication : cxem.net Voir d'autres articles section Application de microcircuits. Lire et écrire utile commentaires sur cet article. Dernières nouvelles de la science et de la technologie, nouvelle électronique : Cuir artificiel pour émulation tactile
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